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  • CERTUS-NX的Versa评估板

    CERTUS-NX的Versa评估板

    包含了丰富的与CERTUS-NX FPGA的开发,应用,包括PCIe,DDR3,以太网PHY,照相机,PMOD多集的高性能接口。
    CERTUS-NX的Versa评估板
  • CNN +加速器IP

    IP核心

    CNN +加速器IP

    实现与细胞神经网络的超低功耗AI解决方案。配置多达16位的宽度。作品有格神经网络编译器软件工具。
    CNN +加速器IP
  • FPD-Link接收

    IP核心

    FPD-Link接收

    模块化MIPI / d-PHY IP - 将转换FPD-LINK视频流像素时钟域
    FPD-Link接收
  • FPD-LINK变送器

    IP核心

    FPD-LINK变送器

    模块化MIPI / d-PHY IP - 转换像素数据流的FPD-LINK视频流
    FPD-LINK变送器
  • SubLVDS图像传感器接收器

    IP核心

    SubLVDS图像传感器接收器

    模块化MIPI / d-PHY IP - 将转换SubLVDS图像传感器视频流像素时钟域
    SubLVDS图像传感器接收器
  • I3C主IP核

    IP核心

    I3C主IP核

    所述MIPI I3C说明书以下总线控制器。高达12.5 MHz的推挽式,传统I2C支持多主机功能,在波段中断,热加入bob电子竞技俱乐部多
    I3C主IP核
  • I3C从IP核

    IP核心

    I3C从IP核

    接口到MIPI I3C规范。高达12.5 MHz的推挽式,传统I2C支持多主机功能,在波段中断,热加入bob电子竞技俱乐部多
    I3C从IP核
  • 三速以太网MAC IP核

    IP核心

    三速以太网MAC IP核

    发送和一个主处理器和一个以太网网络之间接收数据。符合IEEE 802.3标准。bob电子竞技俱乐部支持10/100/1000操作。
    三速以太网MAC IP核
  • GPIO IP核

    IP核心

    GPIO IP核

    通过点阵内存映射接口(LMMI)或高级外围总线接口(APB)检测和控制GPIOs。
    GPIO IP核
  • SPI主机IP核

    IP核心

    SPI主机IP核

    通信与外部SPI从设备。可配置的数据宽度,FIFO的Tx / Rx深度,极性时钟模式和存储器接口。
    SPI主机IP核
  • SPI从IP核

    IP核心

    SPI从IP核

    接口SPI总线。可配置的数据宽度,极性时钟模式和存储器接口。
    SPI从IP核
  • I2C从IP核

    IP核心

    I2C从IP核

    接口I2C总线。bob电子竞技俱乐部支撑件7位和可编程SCL频率10位寻址模式。标准,快速及高速模式八方支援 - 高达1 Mbit / s的bob电子竞技俱乐部
    I2C从IP核
  • I2C主IP核

    IP核心

    I2C主IP核

    控制I2C总线。bob电子竞技俱乐部支撑件7位和可编程SCL频率10位寻址模式。标准,快速及高速模式八方支援 - 高达1 Mbit / s的bob电子竞技俱乐部
    I2C主IP核
  • DDR3 PHY

    IP核心

    DDR3 PHY

    连接一个DDR3存储器控制器(MC)连接到DDR3存储器装置(JESD79-3)。包含依赖于FPGA DDR IO原语功能所需的所有逻辑
    DDR3 PHY
  • DDR3 SDRAM控制器

    IP核心

    DDR3 SDRAM控制器

    与行业标准的DDR3内存(JESD79-3标准)通用完整的内存控制器的接口,并提供了一个通用的命令接口
    DDR3 SDRAM控制器
  • UART 16550 IP核

    IP核心

    UART 16550 IP核

    配置UART端口。兼容PC16550D。7点或8位的数据宽度,1,1.5%,2个停止针对Tx比特。多重校验和波特率选择。
    UART 16550 IP核
  • 色彩空间转换器(CSC)

    IP核心

    色彩空间转换器(CSC)

    免费IP内核 - 支持色彩空间bob电子竞技俱乐部转换和8-16位宽相关的编解码功能,精度可达18位。RGB 的YCbCr CMYK和更多。
    色彩空间转换器(CSC)
  • PCI Express端点核心

    IP核心

    PCI Express端点核心

    提供了从电SERDES接口到事务层的PCI Express X1,X2或x4端点溶液
    PCI Express端点核心
  • 个PCI Express x1,x4的根联合体精简版IP核

    IP核心

    个PCI Express x1,x4的根联合体精简版IP核

    提供了一个x1根复杂的解决方案,从电气SERDES接口,物理层,数据链路层和最小事务层在PCIe协议栈
    个PCI Express x1,x4的根联合体精简版IP核
  • FFT编译

    IP核心

    FFT编译

    可以被配置为执行前向正向FFT,或端口可选择逆FFT(IFFT)/逆FFT。高性能流媒体和低资源连拍模式。
    FFT编译
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