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  • DDR3 SDRAM控制器

    IP核心

    DDR3 SDRAM控制器

    通用完整的内存控制器接口与工业标准DDR3内存(JESD79-3 standard),并提供通用的命令接口
    DDR3 SDRAM控制器
  • LPDDR3 SDRAM控制器

    IP核心

    LPDDR3 SDRAM控制器

    一种通用内存控制器,可与符合JESD-209.3规范的行业标准LPDDR3存储器设备和模块接口
    LPDDR3 SDRAM控制器
  • PCI Express Endpoint Core

    IP核心

    PCI Express Endpoint Core

    提供从电子SERDES接口到事务层的PCI Express x1、x2或x4端点解决方案
    PCI Express Endpoint Core
  • PCI Express x1, x4 Root Complex Lite IP Core

    IP核心

    PCI Express x1, x4 Root Complex Lite IP Core

    从电SERDES接口、物理层、数据链路层和PCIe协议栈的最小事务层提供x1根复杂解决方案
    PCI Express x1, x4 Root Complex Lite IP Core
  • LPDDR SDRAM控制器

    IP核心

    LPDDR SDRAM控制器

    通用内存控制器,与符合JESD209B的行业标准LPDDR内存设备/模块接口
    LPDDR SDRAM控制器
  • 32位PCI主/目标

    IP核心

    32位PCI主/目标

    提供可定制的32/64位主/目标或目标解决方案 - 修订2.2,速度高达66MHz
    32位PCI主/目标
  • 32位PCI目标

    IP核心

    32位PCI目标

    完全符合PCI本地总线规范,修订2.2,速度高达66MHz
    32位PCI目标
  • 64位PCI主/目标

    IP核心

    64位PCI主/目标

    完全符合PCI SIG 3.0,可速度高达66MHz。适用于32/64位主/目标或目标解决方案
    64位PCI主/目标
  • 64位PCI目标

    IP核心

    64位PCI目标

    完全符合PCI SIG 3.0,可速度高达66MHz。适用于32/64位。
    64位PCI目标
  • PHY接口PCI Express - PIPE

    IP核心

    PHY接口PCI Express - PIPE

    用于PCI Express (PCIe)应用程序的PHY设备和媒体访问(MAC)层之间的标准接口bobappios下载地址
    PHY接口PCI Express - PIPE
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