1:2 MIPI DSI显示界面带宽减速器

将输入视频流桥接到两个流或一个下分辨率流中

重要提示:对于新设计,格子建议使用以下模块化IP块来实现此功能:

以下参考设计提供了使用这些模块化IP块的集成示例

移动行业处理器接口(MIPI®)联盟开发了MIPI显示串行接口(DSI)和MIPI D-PHY规范,为移动行业中使用的所有显示器创建标准化接口。随着行业的发展,带宽要求超过显示制造商能够制造的,而应用处理器供应商继续提供非常快速的接口设备。bobappios下载地址CrossLink IP可以帮助解决这些挑战。

对于经济高效的解决方案,稍后可以将显示器替换为较新的显示器,同时保留当前的生成处理器。此外,多个显示器已经受到普及并将输出扩展到来自单个源的两个显示接口成为支持这些应用的关键要求。bobappios下载地址bob电子竞技俱乐部对于高带宽应用程序处理器,通过将输入分bobappios下载地址配到多个显示器,可以减少带宽可以减少带宽。格子1:2 MIPI DSI显示界面带宽减速器IP允许用户解决这些接口问题。

特征

  • 将MIPI DSI兼容接收器接口到两个MIPI DSI发射器
  • bob电子竞技俱乐部支持高达4.8 GB / s MIPI DSI接收界面
  • bob电子竞技俱乐部每个MIPI DSI接口支持四个数据通道和一个时钟通道
  • bob电子竞技俱乐部支持D-PHY连续和非连续时钟模式
  • 符合MIPI D-PHY V1.1和MIPI DSI V1.1规范

框图

文件

快速参考
标题 数字 版本 日期 格式 尺寸
1:2 MIPI DSI显示界面带宽减速器IP
FPGA-IPUG-02028 1.1 5/10/2019 PDF. 2.4 MB.

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