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格子解决方案

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  • I2C总线主

    参考设计

    I2C总线主

    演示如何在晶格CPLD / FPGA设备中构造和使用快速和可配置的I2C总线主控制器
    machxo.，Latticexp2.，ispmach 4000ze.，MachXO2，LatticeEcp3.，平台管理器，ECP5 / ECP5-5G，MachXO3
    总线控制器，I2C，Tor Switch.，家庭控制电器和安全，物联网和衣物，笔记本电脑和PC.，打印机，智能玩具和机器人，平板电脑，5克
    I2C总线主
  • UART参考设计

    参考设计

    UART参考设计

    完全可配置的UART与NS16450 UART功能兼容
    ispmach 4000ze.，machxo.，Latticexp2.，平台管理器
    总线控制器，UART.
    UART参考设计
  • SDR SDRAM控制器高级参考设计

    参考设计

    SDR SDRAM控制器高级参考设计

    为总线主机提供一个简单的通用系统接口，减少了用户处理SDRAM命令接口的工作量。
    machxo.，ispmach 4000ze.，Latticexp2.，MachXO2，LatticeEcp3.，ECP5 / ECP5-5G，MachXO3
    DDR内存*
    SDR SDRAM控制器高级参考设计
  • BSCan - 多端口链接器（BSCan2）

    参考设计

    BSCan - 多端口链接器（BSCan2）

    在FPGA上实现符合IEEE 1149.1标准的边界扫描端口。多个扫描端口链接到IEEE 1149.1端口。
    machxo.，MachXO2，ispmach 4000ze.，ispMACH 4000 v / B / C / Z，Latticexp2.，ECP5 / ECP5-5G
    IEEE 1149.1.，边界扫描
    BSCan - 多端口链接器（BSCan2）
  • 串行eeprom的I2C总线控制器

    参考设计

    串行eeprom的I2C总线控制器

    提供标准微处理器和I2C串行EEPROM设备之间的接口
    machxo.，Latticexp2.，ispmach 4000ze.，MachXO2，LatticeEcp3.，ECP5 / ECP5-5G，MachXO3
    总线控制器，I2C
    串行eeprom的I2C总线控制器
  • I2C奴隶/外围

    参考设计

    I2C奴隶/外围

    在FPGA或CPLD中实现I2C从模块。遵循I2C规范提供设备寻址、读/写操作和确认
    LatticeEcp3.，Latticexp2.，machxo.，平台管理器，ispmach 4000ze.，ECP5 / ECP5-5G
    I2C，Tor Switch.，家庭控制电器和安全，物联网和衣物，笔记本电脑和PC.，打印机，智能玩具和机器人，平板电脑
    I2C奴隶/外围
  • SPI控制器- WISHBONE兼容

    参考设计

    SPI控制器- WISHBONE兼容

    提供带有WISHBONE总线的微处理器和外部SPI设备之间的接口。
    ispmach 4000ze.，machxo.，Latticexp2.，MachXO2，MachXO3
    spi.，汉语，Tor Switch.
    SPI控制器- WISHBONE兼容
  • LPC（低针数）总线控制器

    参考设计

    LPC（低针数）总线控制器

    基于Intel低引脚数接口规范(1.1版)实现低引脚数总线控制器
    MachXO2，Latticexp2.，LatticeEcp3.，ispmach 4000ze.，machxo.
    总线控制器，LPC的，信号汇总，Tor Switch.
    LPC（低针数）总线控制器
  • 读取和写入用户代码

    参考设计

    读取和写入用户代码

    通过通用I/O读取或更改用户代码或用户电子签名(UES)，而无需重新编程整个设备上的Flash或中断系统。
    ispmach 4000ze.，machxo.，MachXO2，MachXO3
    安全，问题
    读取和写入用户代码
  • BSCan - 多端口可寻址缓冲区（BSCan-1）

    参考设计

    BSCan - 多端口可寻址缓冲区（BSCan-1）

    可以通过标准IEEE 1149.1接口访问的多边界扫描测试访问端口（TAP）可寻址缓冲功能
    Latticexp2.，ispmach 4000ze.，machxo.，ispMACH 4000 v / B / C / Z，平台管理器
    边界扫描，IEEE 1149.1.，Tor Switch.
    BSCan - 多端口可寻址缓冲区（BSCan-1）
  • PCI目标32位/ 33MHz

    参考设计

    PCI目标32位/ 33MHz

    完全符合PCI 2.2规范。
    ispmach 4000ze.，machxo.，Latticexp2.，LatticeEcp3.
    总线控制器，PCI.，防御
    PCI目标32位/ 33MHz
  • SPI GPIO扩张器

    参考设计

    SPI GPIO扩张器

    使用串行外设接口（SPI）扩展微处理器通用I / O端口
    平台管理器，machxo.，ispmach 4000ze.
    GPIO控制，信号汇总，软核处理器，spi.，Tor Switch.
    SPI GPIO扩张器
  • GPIO扩展者

    参考设计

    GPIO扩展者

    提供了一种使用Lattice PLD作为GPIO扩展器的解决方案
    LatticeEcp3.，machxo.，Latticexp2.，ispmach 4000ze.，平台管理器
    GPIO控制，信号汇总，Tor Switch.
    GPIO扩展者
  • 高阶资料连结控制控制器

    参考设计

    高阶资料连结控制控制器

    实现HDLC(高级数据链路控制)，位于OSI链路层2。bob电子竞技俱乐部支持LAPB, LAPD, LLC和SDLC与一些修改
    LatticeECP2 / M，ispMACH 4000 v / B / C / Z，ispmach 4000ze.，Latticexp2.，machxo.
    数据通信，以太网
    高阶资料连结控制控制器
  • PWM风扇控制器 - WID WIPHBONE兼容

    参考设计

    PWM风扇控制器 - WID WIPHBONE兼容

    实现PWM风扇控制使用PLD和MOSFET电路提供一个简单的2针或3针风扇的速度控制。
    ispmach 4000ze.，machxo.，Latticexp2.，MachXO2，MachXO3，ispMACH 4000 v / B / C / Z
    脉宽调制，汉语，Tor Switch.
    PWM风扇控制器 - WID WIPHBONE兼容
  • SPI外围

    参考设计

    SPI外围

    实现一个串行外围接口（SPI）从设备接口，提供与SPI主站的全双工，同步，串行通信
    machxo.，ispmach 4000ze.，平台管理器
    总线控制器，spi.，Tor Switch.
    SPI外围
  • 局域网唤醒

    参考设计

    局域网唤醒

    WoL允许网络上的负载/客户端通过通过网络发送的消息打开，通过保持设备处于待机模式以节省电力，直到需要。
    ispmach 4000ze.，machxo.
    以太网，电源管理
    局域网唤醒
  • 快速页面模式DRAM控制器

    参考设计

    快速页面模式DRAM控制器

    实现快速页面模式(FPM) DRAM控制器
    ispmach 4000ze.
    FPM DRAM
    快速页面模式DRAM控制器
  • 用于ISPMACH设备的标准SDRAM控制器

    参考设计

    用于ISPMACH设备的标准SDRAM控制器

    SDRAM接口到标准微处理器，独立于处理器类型。如图所示的设计支持两个16MB内存区域，bob电子竞技俱乐部配置为4 M x 32位
    ispmach 4000ze.，ispMACH 4000 v / B / C / Z
    SDRAM.
    用于ISPMACH设备的标准SDRAM控制器
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