液晶控制器 - 符合WISHBONE兼容

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参考设计标志这个参考设计提供了一个处理器接口到普通的点阵LCD模块。在一些晶格CPLD或FPGA家族上可用的片上振荡器可以通过消除外部时钟源的需要来进一步简化实现。该设计也适用于与Lattice零功耗cpld一起的低功耗应用。bobappios下载地址

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    框图

    性能和尺寸

    测试设备* 语言 性能 I / O引脚 设计的尺寸 修订
    ICE40-LP1K-CM121 硬件描述语言(VHDL) clk_i > 50 MHz 26 67 luts. 1.2
    lcmxo2 - 1200 hc - 4 tg100c Verilog clk_i > 50 MHz 33 25日附近地区 1.2
    lcmxo2 - 1200 hc - 4 tg100c 硬件描述语言(VHDL) clk_i > 50 MHz 33 25日附近地区 1.2
    LCMXO2280C-3FT256C Verilog clk_i > 50 MHz 33 23 Luts. 1.2
    LCMXO2280C-3FT256C 硬件描述语言(VHDL) clk_i > 50 MHz 33 23 Luts. 1.2
    LFXP2-5E-5TN144C Verilog clk_i > 50 MHz 33 25日附近地区 1.2
    LFXP2-5E-5TN144C 硬件描述语言(VHDL) clk_i > 50 MHz 33 25日附近地区 1.2

    *也可以在其他设备上工作。

    请注意：上面显示的性能和设计尺寸仅估计。实际结果可能根据所选择的参数，时序约束和设备实现而变化。有关详细信息，请参阅设计的文档。除非另有说明，否则所有编码和设计工作都在PC平台上完成。

    文档

    技术资源
    标题 数量 版本 日期 格式 大小
    LCD控制器 - 源代码
    		 RD1149 1.0 4/8/2013 邮政编码 163 KB
    LCD控制器-文档
    		 RD1149 1.0 4/9/2013 PDF 483.8 KB.
    wishbone兼容的LCD控制器-源代码
    		 RD1053. 1.2 11/8/2010 邮政编码 140.9 KB

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