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电平标准。204 b (JESD204B)定义了数据转换器和逻辑器件之间的一个串行接口。它包含了设计人员用于实现能够与其他符合该标准的器件(转换器)进行通信的逻辑器件的必要信息。莱迪思的JESD204B 3 g / 5 g IP核支持一个Rx核(ADC到FPGA)和/或一个Tx核(FPGA到DAC)。Rx和Tx核都可以分别产生,使用不同的参数。
IP版本:3.3
评估:下载该IP的完整评估版,请使用IPexpress工具并点击工具条上的IP服务器按钮。可查看所有可供下载的LatticeCORE IP核和模块。查看/下载IP的更多信息,请访问IP表达快速入门指南。
购买:如要购买该IP核,请联系您当地的莱迪思销售办事处。