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该参考设计是为了演示如何用莱迪思的CPLD / FPGA器件构建和使用快速和可配置的I2C总线主控制器。I2C总线主控制器提供了灵活性,设计者可以使它与多达128个不同的I2C从设备进行通信,以标准或快速模式工作,处理范围从1到256字节。用户还可以编写硬件描述语言(VHDL)代码,以满足自己的具体要求,从而减少占用宝贵的CPLD / FPGA资源,并同时保持他们所期望的莱迪思器件的速度性能。这个设计符合飞利浦的I2C总线规范1.0版本。
1.使用LFE3-17EA-6FTN256C器件和晶格钻石™3.1设计软件测得的性能和资源使用数据。2.使用LCMXO2-256HC-4TG100C器材和所有LSE(莱迪思融合引擎)的格子Diamond™3.1设计软件测得的性能和资源使用数码。3.使用LCMXO256C-3T100C器件和带有伦敦的晶格钻石™3.1设计软件测得的性能和资源使用数据。4.使用LFXP2-5E-5M132C器件和晶格钻石™3.1设计软件测得的性能和资源使用数据。5.使用LC4256ZE-5TN144C器件和ispLEVER®1.4经典软件测得的性能和资源使用数据。6.使用lptm10 - 1247 - 3 - tg128ces器件和晶格钻石™3.1设计软件测得的性能和资源使用数据。7.使用LFE5U-45F-6MG285C器件和带有伦敦的晶格钻石™3.1设计软件产生测得的性能和资源使用数据。8.使用LCMXO3L-4300C-6BG256C器材和销售LSE的晶片™3.1设计软件以及SynplifyPro®测得的性能和资源使用数控。
*也可用力器材。
注意:以上的所示和设计仅仅估计。实际结果可能所选择的次数,时尚和所用的。若要了解更详细,请查阅设计文。除非查阅设计文明。除非另有望明,没有的代码和设计工作又在个人电脑平台上的。