10 gb +以太网MAC


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10 gb +以太网媒体访问控制器(MAC)在主机处理器和一个以太网网络之间发送和接收数据。10 gb +以太网MAC的主要功能是确保在通过以太网传输数据帧时,能够满足IEEE802.3ae标准规定的媒体访问规则。在接收端,以太网MAC提取数据帧中的不同成分,并通过一个FIFO接口传输到更高的应用层。

特性

  • 符合-2005年IEEE 802.3标准,成功通过新罕布什尔大学互操作性实验室(UNH - IOL)的对10 gbe MAC硬件测试
  • 支持标准的10 gbps以太网链路层数据传输速率
  • 支持速率高达12 gbps的超频
  • 64位内部数据路径宽度,工作频率为156.25 mhz至187.5 mhz
  • XGMII接口到物理层(使用IODDR外部连接到内核)
  • XAUI接口到物理层(使用pc /并行转换器外部连接到内核)
  • 简单的FIFO接口到用户应用
  • 可选的多播地址过滤
  • 发送和接收统计向量
  • 可选的统计计数器长度,对于所有器件从16至40位(统计计数器外部连接到内核)
  • 可编程的内部数据帧间隙
  • 支持:
    • 全双工工作
    • 使用暂停帧的流控制
    • VLAN标记帧
    • 自动填充短帧
    • 在传输过程中可选的FCS产生
    • 接收过程中可选的FCS去除
    • 巨型帧高达16 k
    • 在传输过程中的帧间延伸模式
    • 缺损空闲计数

通过将10 Gb +以太网MAC系统时钟速率从由处理10 gbps数据的156.25 mhz标准频率提高至187.50 mhz,提供高达12 gbps的数据速率。

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块关系图

性能和大小

LatticeECP31
模式 附近地区 寄存器 外部引脚2 sysMEM EBR f马克斯(MHz)
多播地址过滤 3239 4024 2833 78 4 160

1.使用LFE3-35EA-8FN672C器件和莱迪思的钻石1.1软件和Synplify Pro d - 2010.03 - l - sp1综合得到的性能和资源使用数据。当使用不同的软件版本或LatticeECP3系列中不同密度或速度级的目标器件时,性能可能会有所不同。
2.10 Gb +以太网MAC核本身不使用任何外部引脚。然而,在实际应用中,该内核与集成在LatticeECP3系列FPGA中的IODDR和I / O缓冲器一起使用。因此,实现10 Gb +以太网MAC规范的应用将用到I / O引脚。

LatticeECP2M /秒1
模式 附近地区 寄存器 外部引脚2 sysMEM EBR f马克斯(MHz)
多播地址过滤 3153 4370 2777 78 4 181

1.使用LFE2M35E-7F672C器件和莱迪思的钻石1.1软件和Synplify Pro d - 2010.03 - l - sp1综合得到的性能和资源使用数据。当使用不同的软件版本或LatticeECP2M / S系列中不同密度或速度级的目标器件时,性能可能会有所不同。
2.10 Gb +以太网MAC核本身不使用任何外部引脚。然而,在实际应用中,该内核与集成在LatticeECP2M系列FPGA中的IODDR和I / O缓冲器一起使用。因此,实现10 Gb +以太网MAC规范的应用将用到I / O引脚。

LatticeECP2 /秒1
模式 附近地区 寄存器 外部引脚2 sysMEM EBR f马克斯(MHz)
多播地址过滤 3153 4022 2777 78 4 170

1.使用LFE2-35E-7F672C器件和莱迪思的钻石1.1软件和Synplify Pro d - 2010.03 - l - sp1综合得到的性能和资源使用数据。当使用不同的软件版本或LatticeECP2 / S系列中不同密度或速度级的目标器件时,性能可能会有所不同。
2.10 Gb +以太网MAC核本身不使用任何外部引脚。然而,在实际应用中,该内核与集成在LatticeECP2系列FPGA中的IODDR和I / O缓冲器一起使用。因此,实现10 Gb +以太网MAC规范的应用将用到I / O引脚。

LatticeSC / M1
模式 附近地区 寄存器 外部引脚2 sysMEM EBR f马克斯(MHz)
多播地址过滤 2961 4370 2764 78 4 205

1.使用LFSC3GA25E-5F900C器件和莱迪思的钻石1.1软件和Synplify Pro d - 2010.03 - l - sp1综合得到的性能和资源使用数据。当使用不同的软件版本或LatticeSC系列中不同密度或速度级的目标器件时,性能可能会有所不同。
2.10 Gb +以太网MAC核本身不使用任何外部引脚。然而,在实际应用中,该内核与集成在LatticeSC系列FPGA中的IODDR和I / O缓冲器一起使用。因此,实现10 Gb +以太网MAC规范的应用将用到I / O引脚。

订购信息

系列 部件编号
LatticeECP3 ETHER-10G-E3-U4
LatticeECP2M ETHER-10G-PM-U4
LatticeECP2 ETHER-10G-P2-U4
LatticeSC / M ETHER-10G-SC-U4

IP版本:4.3

评估:欲下载该完整的评估版IP,请访问IPexpress工具并点击工具条上的IP服务器按钮。然后就可以看到所有可用和可下载的LatticeCORE IP核和模块。欲了解更多有关查看/下载IP的信息,请阅读IP表达快速入门指南

购买:欲了解如何购买IP核,请联系您当地的莱迪思销售办事处

文档

快速参考
资讯资源
标题 编号 版本 日期 格式 文件大小
LatticeECP3和Marvell 10 Gbps物理/MAC层互操作性
TN1219 1.0 7/26/2010 PDF 1.4 MB
LatticeECP3和Broadcom 10 Gbps物理/MAC层互操作性
TN1218 1.1 2/13/2012 PDF 3.5 MB
标题 编号 版本 日期 格式 文件大小
LatticeECP3和Marvell 10 Gbps物理/MAC层互操作性
TN1219 1.0 7/26/2010 PDF 1.4 MB
LatticeECP3和Broadcom 10 Gbps物理/MAC层互操作性
TN1218 1.1 2/13/2012 PDF 3.5 MB
标题 编号 版本 日期 格式 文件大小
10Gb+以太网MAC用户指南
10 g以太网MAC
IPUG39 02.9 12/28/2010 PDF 864.1 KB
LatticeECP3和ECP5 10Gb以太网MAC IP核心用户指南
10 g以太网MAC
IPUG114 1.0 4/24/2015 PDF 4.2 MB
标题 编号 版本 日期 格式 文件大小
IPexpress快速入门指南
8/5/2010 PDF 304.8 KB
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