LPDDR SDRAM控制器


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IP表达LPDDR同步动态随机存取存储器（SDRAM）控制器是一个通用内存控制器，它与符合JESD209B，LPDDR SDRAM标准的行业标准LPDDR存储器设备/模块接口，并为用户应用程序提供通用命令接口。bobappios下载地址此IP核心减少了将LPDDR内存控制器与应用程序的其余部分集成所需的努力，并最大限度地减少直接处理LPDDR存储器接口的需要。

    特征

    • 根据JESD209B的工业标准LPDDR SDRAM的界面
    • 双数据速率架构;每个时钟周期的两个数据传输
    • 每个字节的双向数据选通（DQS）
    • 可编程自动刷新支持bob电子竞技俱乐部
    • 数据掩码支持 - 每bob电子竞技俱乐部个字节的一个掩码
    • 掉电和深度下降支持bob电子竞技俱乐部
    • bob电子竞技俱乐部支持电源初始化
    • bob电子竞技俱乐部在深度下降后支持重新初始化
    • 初始化后动态I / O培训
    • 自动刷新后的定期I / O刷新
    • 自刷新期间动态内存时钟断电，电源下降和深度下电操作
    • bob电子竞技俱乐部支持单端口操作
    • bob电子竞技俱乐部支持完整，半和四分之一阵列自我刷新
    • 状态寄存器读取支持bob电子竞技俱乐部
    • 通过MRS的TCSR可编程性

    LPDDR SDRAM控制器可用作IPExpress用户可配置的IP核心，允许配置IP和生成NetList和模拟文件以用于设计。请注意，可以防止生成比特流，或者比特流可能有时间逻辑存在，除非购买IP的许可。

    跳到

    框图

    性能和规模

    参数 切片 luts. 寄存器 F最大限度（MHz）
    数据宽度：16
    行宽度：14
    COL宽度：10
    汉语：残疾人士：    		 900 1675. 1100 133.
    数据宽度：16
    行宽度：13
    COL宽度：10
    汉语：残疾人士：    		 850. 1600 1000 133.
    数据宽度：8
    行宽度：13
    COL宽度：9
    汉语：残疾人士：    		 850. 1575. 950. 133.
    数据宽度：8
    行宽度：12
    COL宽度：9
    汉语：残疾人士：    		 825. 1550. 925. 133.
    数据宽度：16
    行宽度：14
    COL宽度：10
    汉语：两个港口    		 1200. 2300 1500 100.
    数据宽度：8
    行宽度：12
    COL宽度：9
    汉语：一个港口    		 700 1350. 900 100.

    1.使用Latice Diamond 3.1设计软件中的LCMXO2-7000HE-6FG484C设备生成性能和利用数据。在MachXO2系列中使用不同密度，速度或等级使用此IP内核的性能可能会有所不同。

    订购信息

    家庭 零件号
    machxo2. lpddrct-wb-m2-u

    IP版本：2.0。

    评估：要下载此IP的完整评估版本，请转到IPExpress工具，然后单击工具栏中的IP服务器按钮。所有Latticecore IP核心和可用于下载的模块将可见。

    购买：要了解如何购买IP内核，请联系您的当地格子销售办事处。

    文件

    快速参考
    标题 数字 版本 日期 格式 尺寸
    LPDDR SDRAM控制器IP核心用户指南
    		 ipug92. 1.3 2014年1月2日 PDF. 2.6 MB.

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