LVDS视频接口MachXO2/3和ECP5

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由多个数据位和时钟组成的源同步接口已经成为电子系统中移动图像数据的常用方法。一种流行的标准是7:1 LVDS视频接口(在Channel Link、Flat Link和Camera Link中使用)，它已经成为许多电子产品的通用标准，包括消费设备、工业控制、医疗和汽车远程信息处理。在许多这样的应用中，使用低成本可编bobappios下载地址程逻辑器件进行图像处理的实践已经变得相当普遍。

MachXO2、MachXO3和ECP5 PLD系列已专门设计以支持显示接口(7:1 LVDS)视频标准，内置专用硬件接口块。bob电子竞技俱乐部本文档介绍了使用这些设备实现该接口的方法和优点。通过扩展，这些设备对显示接口bob电子竞技俱乐部的支持也证明了硬件实现所有其他LVDS源同步要求的可行性。

在本文档的讨论中包含了两种设计。第一个设计是一个简单的环回测试，演示了显示接口发射器和显示接口接收器的使用。第二个设计是一个例子，将视频数据通过显示接口接收器带入PLD，处理后通过显示接口发射器发送出去。两种设计都通过MachXO2控制评估板进行验证。

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    框图

    性能和尺寸

    设计1:环回测试结果
    设备的家庭 语言 速度等级 利用率(附近地区) fmax (MHz) I / o
    ECP53. Verilog-LSE －8 421 108 31
    Verilog-Syn －8 426 108 31
    Verilog-LSE －8 426 108 31
    Verilog-Syn －8 421 108 31
    MachXO3L2 Verilog-Syn －６ 352 85 31
    Verilog-LSE －６ 390 85 31
    VHDL-Syn －６ 354 85 31
    VHDL-LSE －６ 413 85 31
    MachXO21 Verilog-LSE －６ 390 85 31
    Verilog-Syn －６ 352 85 31
    VHDL-LSE －６ - - 31
    VHDL-Syn －６ - - 31

    1.使用LCMXO2-1200HC-6MG132C与Lattice Diamond®3.4设计软件生成性能和利用特性。当在不同的设备上使用本设计时，密度、速度或等级、性能和利用率可能会有所不同。
    2.使用LCMXO3L-4300C-6BG256C和Lattice Diamond 3.4设计软件生成性能和利用特性。当在不同的设备上使用本设计时，密度、速度或等级、性能和利用率可能会有所不同。
    3.使用LFE5UM-85F-8BG765CES和Lattice Diamond 3.4设计软件生成性能和利用特性。当在不同的设备上使用本设计时，密度、速度或等级、性能和利用率可能会有所不同。

    设计2:视频演示测试结果
    设备的家庭 语言 速度等级 利用率(附近地区) fmax (MHz) I / o
    ECP53. Verilog-LSE －8 379 108 29
    Verilog-Syn －8 399 108 29
    Verilog-LSE －8 379 108 29
    Verilog-Syn －8 419 108 29
    MachXO3L2 Verilog-Syn －６ 327 85 29
    Verilog-LSE －６ 340 85 29
    VHDL-Syn －６ 327 85 29
    VHDL-LSE －６ 340 85 29
    MachXO21 Verilog-LSE －６ 364 85 29
    Verilog-Syn －６ 327 85 29
    VHDL-LSE －６ 413 85 29
    VHDL-Syn －６ 354 85 29

    1.使用LCMXO2-1200HC-6MG132C和Lattice Diamond 3.4设计软件生成性能和利用特性。当在不同的设备上使用本设计时，密度、速度或等级、性能和利用率可能会有所不同。
    2.使用LCMXO3L-4300C-6BG256C和Lattice Diamond 3.4设计软件生成性能和利用特性。当在不同的设备上使用本设计时，密度、速度或等级、性能和利用率可能会有所不同。
    3.使用LFE5UM-85F-8BG765CES和Lattice Diamond 3.4设计软件生成性能和利用特性。当在不同的设备上使用本设计时，密度、速度或等级、性能和利用率可能会有所不同。

    文档

    技术资源
    标题 数量 版本 日期 格式 大小
    MachXO2, MachXO3和ECP5 7:1 LVDS视频接口-源代码
    		 RD1093 1.4 9/17/2015 邮政编码 1.9 MB
    MachXO2, MachXO3和ECP5 7:1 LVDS视频接口-文档
    		 fpga - rd - 02093 1.5 1/22/2021 PDF 1.2 MB

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