由SDRAM轻量版控制器IP核

JESD209-2B通用存储器控制器

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基于莱迪思FPGA的销售由解决方案——莱迪思低功耗双倍数据速率(由)同步动态随机存储器(SDRAM)轻量版控制器是一款通用的存储器控制器,可连接行业标准的,符合JESD209-2B规范的销售由存储器和模块。

将lpddr2轻松轻松成到您的设计中——该IP核能让您将由存储器控制器轻松集成到现有的定制化设计中。

特性

  • 可连接行业标准的,符合JESD209-2B规范的销售由SDRAM组件和模块
  • 高性能由,速率高达400 MHz / 800 Mbps
  • 的支持由SDRAM自动初始化和刷新
  • 支持深度掉电模式

注意:该“轻量版“IP仅支持由和LPDDR3共有的特性和指令。故只支持突发长度为8，不支持4或者16。并且不支持闪存指令(LPDDR2-N)。

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    框图

    性能和尺寸

    ECP51
    参 片 lut. 寄存器 I / O2 f马克斯(MHz)3.
    数据总线宽度:16周() 1599 2241 1639 34 400mhz (800mbps)
    数据总线宽度:32 (x32) 1818 2462 1937 54 400mhz (800mbps)

    1.使用LFE5UM - 85 f - 8 bg756ces器件和带有LFE5UM控制包的晶格钻石3.10软件产生的性能和资源使用数据。使用不同的软件版本,或LatticeECP5系列不同密度或速度等级的器件,性能可能会有所不同。
    2.I / O列显示的数字表示由存储器接口占有的主要的I / O数量。用户接口(本地端)的I / O不包括在内。
    3.当使用32位或更低的数据宽度并使用一个片选时,由IP核在最快的速度等级(8)下的运行速度可达到400 MHz(800由)。

    订购信息

    产品系列 订购编号 描述
    Crosslink-NX. lpddr2l-cnx-u 单次设计许可
    Crosslink-NX. LPDDR2L-CNX-UT 多站点许可
    ECP5 LPDDR2L-E5-U 单次设计许可
    ECP5 LPDDR2L-E5-UT 多站点许可

    IP版本:1.0

    评估:欲下载该IP的完整评估版本,请使用清晰设计师工具,并单击页面上的晶格IP服务器选项。您可以看到可供下载的所有LatticeCORE IP核和模块。

    购买:欲了解如何购买IP核,请联系您当地的莱迪思销售办事处。

    文档

    快速参考
    标题 编号 版本 日期 格式 文件大小
    《LPDDR2 SDRAM Controller Lite IP Core User Guide》
    		 fpga - ipug - 02046 1.1 8/26/2020 PDF 1.2 MB
    LPDDR2 SDRAM控制器IP核心-点阵辐射软件
    		 fpga - ipug - 02089 1.5 6/23/2021 PDF 1.4 MB
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