GPIO扩展器

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参考设计徽标对于许多应用来说，通常会需要比微处理器所提供的还要多的通用I / O（GPIO）端口。本设计提供了一种解决方案，它将一款莱迪思的PLD用作GPIO扩展器。当微处理器没有足够的I / O端口时，提供额外的控制（控制信号和数据输出信号）和监测（输入数据信号）功能。该设计通过常用的时序实现微处理器与后端器件的通信。

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    框图

    性能和大小小

    经测试的器件* 语言 性能 I / O引脚 设计所用资源 版本
    LCMXO640C-3T100C 的Verilog / VHDL > 100兆赫 47. 206分之238的LUT 1.2
    LC4256ZE-5TN100C 的Verilog / VHDL > 100兆赫 47. 194分之187个宏单元 1.2
    LFE3-17EA-6FTN256C 的Verilog / VHDL > 100兆赫 47. 211分之242的LUT 1.3
    LFXP2-5E-5TN144C 的Verilog / VHDL > 100兆赫 47. 274分之277的LUT 1.3
    LPTM10-12107-3FTG208CES 的Verilog / VHDL > 100兆赫 47. 二百○七分之二百五的LUT 1.2

    *可能可以在其它器件中正常工作。

    注：以上所示的性能和设计尺寸只是估计。实际结果可能取决于所选择的参数，时序约束和实现的器件。对于更详细的内容，请查阅设计文件。除非另有说明，所有的代码和设计工作都是在PC平台上完成的。

    文章

    技术资源
    标题 编 版本 日期 格哈 文件大小
    GPIO扩展器，文件
    		 RD1065 1.3 2011年11月4日 PDF. 280.6 KB
    GPIO扩展器，源代码
    		 RD1065 1.3 2011年11月4日 压缩 195.5 KB.
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