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machxo3.

参考设计标志该参考设计旨在演示如何在晶格CPLD / FPGA器件中构造和使用快速和可配置的I2C总线主控制器。随着该I2C总线主控制器提供的灵活性，设计人员可以使用高达128个不同的I2C从设备进行通信，其中包含标准或快速模式的交易范围为1到256字节。用户还可以自定义VHDL代码以满足自己的特定要求，从而减少有价值的CPLD / FPGA区域，同时保持他们从格子设备期望的速度性能。该设计符合飞利浦I2C总线规范1.0版。

I2C总线主控制器

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    性能和规模

    设备家庭 测试设备* 表现 I / O引脚 利用 修订
    ECP5™7. LFE5U-45F-6MG285C > 33MHz. 18. 198 Luts. 5.8
    latticeecp3™1 LFE3-17EA-6FTN256C > 33MHz. 18. 200 LUT. 5.8
    machxo3l™8. lcmxo3l - 4300 c - 6 bg256c > 33MHz. 18. 204 LUT（Verilog-LSE Source） 5.8
    190 luts（Verilog-syn源） 5.8
    200 LUT（VHDL-LSE来源） 5.8
    191 LUTS（VHDL-SYN来源） 5.8
    machxo2™2 LCMXO2-256HC-4TG100C > 33MHz. 18. 191卢特 5.8
    machxo™3. LCMXO256C-3T100C. > 33MHz. 18. 192 Luts. 5.8
    Latticexp2™4. LFXP2-5E-5M132C > 33MHz. 18. 201 LUT 5.8
    ISPMACH®4000ze.5. LC4256ZE-5TN144C. > 33MHz. 18. 154附近地区 5.8
    Platform Manager™6. lptm10-1247-3tg128ces. > 33MHz. 18. 192 Luts. 5.8

    1.使用LFE3-17EA-6FTN256C使用LatticeDiamond®3.1设计软件产生性能和利用特性。
    2.使用带LSE钻石3.1设计软件的LCMXO2-256HC-4TG100C产生性能和利用特性。
    3.使用LTICE钻石3.1设计软件使用LCMXO256C-3T100C生成性能和利用特性。
    4.使用LFXP2-5E-5M132C使用带格式钻石3.1设计软件的性能和利用特性。
    5.使用LTC4256ZE-5TN144C使用LatticeIsplever®Classic1.4软件生成性能和利用特性。
    6.使用带有格子钻石3.1设计软件的LPTM10-1247-3TG128生成性能和利用特性。
    7.使用LY5U-45F-6MG285C使用LATTICE Diamond 3.1设计软件，使用LFE5U-45F-6MG285C生成性能和利用特性。
    8.使用带LSE和SynplifyPro®的Latice Diamond 3.1设计软件使用LCMXO3L-4300C-6BG256C生成性能和利用特性。

    *也可以在其他设备中工作。

    笔记：上面显示的性能和设计尺寸仅估计。实际结果可能根据所选择的参数，时序约束和设备实现而变化。有关详细信息，请参阅设计的文档。除非另有说明，否则所有编码和设计工作都在PC平台上完成。

    文件

    技术资源
    标题 数字 版本 日期 格式 尺寸
    I2C（集成电路间电路）主控制器 - 源代码
    		 RD1005. 5.9 1/10/2015 压缩 809.7 KB.
    MACKXO的I2C主控制器源代码
    		 7/1/2005 压缩 6.3 MB.
    I2C（集成电路间电路）主控制器 - 文档
    		 RD1005. 5.8 2014年3月3日 PDF. 987.4 KB.

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