LPC（低引脚数）总线仪器

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参考设计徽标莱迪思的LPC总线仪器参考参考了LPC手机和LPC外研心，支持所需的七个LPC控制信号。这个这个用Verilog或vhdl实现，莱迪思的设计工具用料杂合，布鲁和布线，以及模拟。可以针对性地用过仪器件系列进行设计，它占用来很资源的特性使其能够移植资源资源到移植到不成员的fpga / cpld〗。当然是基于基因英语英特尔的分数少的接口规范（1.1版）。

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    框图

    性能和大小小

    经测试的器材* 语言 性能 I / O引脚 占用资源 修订版
    LPC手机
    LCMXO2-1200HC-5MG132 verilog. > 33MHz. 50. 99 LUT 1.5
    LCMXO2-1200HC-5MG132 VHDL. > 33MHz. 50. 93 LUT. 1.5
    LCMXO256C-3T100C. verilog. > 33MHz. 50. 109 luts. 1.5
    LCMXO256C-3T100C. VHDL. > 33MHz. 50. 96 LUTS. 1.5
    LC4256ZE-5TN100C verilog. > 33MHz. 50. 26宏小区 1.5
    LC4256ZE-5TN100C VHDL. > 33MHz. 50. 26宏小区 1.5
    LFE3-95EA-7FN1156C verilog. > 33MHz. 52. 107 luts. 1.6
    LFE3-95EA-7FN1156C VHDL. > 33MHz. 52. 109 luts. 1.6
    LFXP2-5E-5M132C verilog. > 33 MHz. 50. 119 LUTS. 1.6
    LFXP2-5E-5M132C VHDL. > 33MHz. 50. 119 LUTS. 1.6
    LPC外设
    LCMXO2-1200HC-5MG132 verilog. > 33MHz. 52. 75卢特 1.5
    LCMXO2-1200HC-5MG132 VHDL. > 33MHz. 52. 73 Luts. 1.5
    LCMXO256C-3T100C. verilog. > 33MHz. 52. 75卢特 1.4
    LCMXO256C-3T100C. VHDL. > 33MHz. 52. 73 Luts. 1.5
    LC4256ZE-5TN100C verilog. > 33MHz. 52. 66宏小区 1.4
    LC4256ZE-5TN100C VHDL. > 33MHz. 52. 66宏小区 1.5
    LFE3-95EA-7FN1156C verilog. > 33MHz. 52. 96 LUTS. 1.6
    LFE3-95EA-7FN1156C VHDL. > 33MHz. 52. 97 LUT. 1.6
    LFXP2-5E-5M132C verilog. > 33MHz. 52. 90卢特 1.6
    LFXP2-5E-5M132C VHDL. > 33MHz. 52. 95 LUT 1.6

    *也可用力器材。

    注意：以上的所示和设计仅仅估计。实际结果可能所选择的次数，时尚和所用的。和设计工作又在个人电脑平台上的。

    文章

    技术资源
    标题 编 版本 日期 格哈 文件大小
    LPC（低针数）总线控制器 - 源代码
    		 RD1049. 1.6 2011年11月4日 压缩 517.2 KB.
    LPC（低引脚数）总线控制器参考设计 - 文档
    		 FPGA-RD-02114 1.7 1/21/2021 PDF. 1 MB.
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