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基于LPDDR2的晶格FPGA解决方案- The Lattice Low Power Double Data Rate (LPDDR2) Synchronous Dynamic Random Access Memory (SDRAM) Controller Lite是一种通用内存控制器,与符合行业标准的LPDDR2内存设备和符合JESD209-2B规范的模块接口。
轻松地将LPDDR2集成到您的设计中-该IP核减少了将LPDDR2内存控制器与客户设计的其余部分集成所需的工作。
注意:此“Lite”版本IP仅支持LPDDR2与LPDDR3共有的功bob电子竞技俱乐部能和命令。这意味着支持8的突发长度,但不支持4和16。此外,不支持闪存命令(LPDDR2-N)。
1.使用Lattice Diamond 3.10设计软件和LFE5UM控制包,针对LFE5UM- 85f - 8bg756ces设备生成性能和利用率数据。当使用不同的软件版本或针对ECP5系列中不同的设备密度或速度等级时,性能可能会有所不同。2.I/O列中显示的数字表示LPDDR2内存接口的主I/O数量。不包括用户界面(本地端)I/ o。3.LPDDR2 IP核可以工作在400 MHz (800 LPDDR2)在最快的速度等级(-8),当数据宽度是32位或更少,并使用一个芯片选择。
IP版本:1.0
评估:要下载这个IP的完整评估版本,请转到Clarity Designer工具,并在窗口中单击Lattice IP Server选项卡。所有可下载的LatticeCORE IP核和模块将是可见的。
购买:想知道如何购买IP核,请与您的当地联系莱迪思销售处.
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